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DESCRIPCIÓN
El DS1307 Real-Time-Clock Serie, es un dispositivo de bajo consumo de energía,
completo con código binario decimal (BCD), reloj/calendario más 56 bytes de NV SRAM.
Dirección y datos son transferidos a través de 2 hilos serie, bus bi-direccional. El
reloj/calendario provee información de, segundos, minutos, horas, día, fecha, mes y año.
El final de fecha de mes se ajusta automáticamente durante meses menores de 31 días,
incluyendo correcciones para el año bisiesto. El reloj funciona en cualquiera formato de
24 horas o en 12 horas con indicador AM/PM. El DS1307 tiene incorporado un circuito de
sensor de tensión que detecta fallas de energía y cambia automáticamente al suministro
de batería de respaldo.
CARACTERÍSTICAS
° Reloj en tiempo real (RTC) Cuenta segundos, Minutos, horas, fecha del mes, mes, día
de la semana, y año con año bisiesto Compensación Válido hasta 2100.
° 56-Byte, con respaldo de batería, no volátil (NV) de RAM para almacenamiento de datos
° Interface Serie I2C.
° Onda-Cuadrada programable de la señal de salida.
° Detector Automático Fallo-Energía y Circuito Conmutación.
° Consume menos de 500nA en la batería -- Modo de copia de seguridad con el oscilador
funcionando.
° Rango de temperatura Industrial Opcional: -40 ° C a +85 ° C
° Disponible en 8-Pin Plástico DIP o SO
° Reconocido Underwriters Laboratory (UL)
El Circuito Típico de funcionamiento y Configuraciones de pines aparecen al final de hoja
de datos. Ver niveles de tensión y otras características en el propio DS.
Traducción libre por V. García.
64 x 8 Serial Real Time Clock
Circuito Típico.
09-11-2.009
DS1307
1
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Resumen de contenidos para Maxim Real-Time-Clock Serie
- Página 1 64 x 8 Serial Real Time Clock DESCRIPCIÓN El DS1307 Real-Time-Clock Serie, es un dispositivo de bajo consumo de energía, completo con código binario decimal (BCD), reloj/calendario más 56 bytes de NV SRAM. Dirección y datos son transferidos a través de 2 hilos serie, bus bi-direccional. El reloj/calendario provee información de, segundos, minutos, horas, día, fecha, mes y año.
- Página 2 OPERACIÓN. El DS1307 funciona como un dispositivo esclavo en el bus serie. El acceso se obtiene mediante la aplicación de una condición de START (Inicio) y la prestación de un código de identificación del dispositivo seguido de una dirección de registro. Se puede acceder a registros posteriores de forma secuencial hasta que es ejecutada una condición STOP.
-
Página 3: Disposición Recomendada Para Cristal
Reconocimiento UL asegura contra inversión de corriente de carga cuando se utiliza junto con un batería de litio. Ver “Condiciones de accesibilidad” en: http://www.maxim-ic.com/TechSupport/QA/ntrl.htm SCL (Serial Clock Input) - SCL se utiliza para sincronizar el movimiento de datos en la interfaz de serie. -
Página 4: Rtc Y Ram Mapa De Direcciones
RTC Y RAM MAPA DE DIRECCIONES El mapa de direcciones para registros del RTC y RAM del DS1307 es mostrado en la Figura 2. Los registros de RTC están situados en localizaciones de dirección 00h a 07h. Los registros RAM están situados en dirección de localizaciones 08h a 3Fh. Durante un acceso multi-byte, cuando el puntero llega a la dirección 3Fh, el fin del espacio de RAM, envuelve alrededor a la localización 00h, el principio del espacio de reloj. - Página 5 seleccionado es alto, es de 12 horas. En el modo 12 horas, el bit 5 es el bit AM/PM con lógica alta es PM. En modo 24 horas, el bit 5 es el bit, segundas 10 horas (20 - 23 horas). Al leer o escribir los registros de hora y fecha, actual se transfiere a un segundo conjunto de registros (buffer) para evitar errores cuando los registros internos se actualizan.
-
Página 6: Frecuencia Cuadrada De Salida
Bit 7: OUT (Output control - control de Salida): Este bit controla el nivel de salida del pin SQW/OUT cuando la salida de onda cuadrada es inutilizada. Si SQWE = 0, el nivel lógico en el pin SQW/OUT es 1, si OUT = 1 y SQW/OUT es 0 si OUT = 0. Bit 4: SQWE (Square Wave Enable - Onda Cuadrada Habilitada): Este bit, cuando se establece a lógica 1, habilita la salida del oscilador. -
Página 7: Transferencia De Datos En 2-Wire Bus Serie
Durante la transferencia de datos, la línea de datos debe permanecer estable cuando la línea de reloj es ALTA. Los cambios en la línea de datos, mientras la línea de reloj es alta, se interpretan como señales de control. En consecuencia, las siguientes condiciones de bus han sido definidas: Bus no ocupado: Ambos datos y líneas de reloj permanecen ALTOS. -
Página 8: Escribir Datos - Modo Receptor Esclavo
Dependiendo del estado del bit de R/W, dos tipos de transferencia de datos son posibles: La transferencia de datos desde un transmisor maestro a un receptor esclavo. El primer byte transmitido por el maestro es la dirección de esclavo. Sigue después una reconocido serie de bytes de datos. -
Página 9: Leer Datos - Modo Transmisor Esclavo
la dirección de byte el dispositivo introduce un reconocido en la línea SDA. El DS1307 entonces comienza a transmitir los datos que comienzan con la dirección de registro indicada por el indicador de registro. Si el puntero de registro no es escrito antes de la iniciación de un modo de leer la primera dirección que es leída, es la última almacenada en el registro puntero. - Página 10 1. El acoplamiento de ruido en el cristal de las señales adyacentes: Este problema ha sido ampliamente cubierto por encima. El acoplamiento de ruido suele provocar en un reloj de tiempo real sea manifiestamente inexacta. 2. Cristal incorrecto: Un reloj de tiempo real normalmente correrá rápido, si se utiliza un cristal con una capacidad de carga específica (CL) de más de 6 pF.
- Página 11 se borra, como se requiere. Muchos RTC Dallas Semiconductor incluyen un circuito que impedirá al oscilador correr cuando el suministro se aplicó por primera vez. Esto permite a un sistema esperar el envío al cliente, sin llamar la alimentación de la batería de reserva.