Mitsubishi Electric MELSEC System Q Manual De Usuario página 285

Controladores lógicos programables
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Código transparente y código adicional
³
Poniendo X50 se da inicio al envío de los datos. La interfaz CH1 se selecciona entrando
"1" en el registro D0.
·
D2 contiene la indicación de la longitud de los datos. Aquí en este ejemplo se trata de
4 palabras.
»
En el registro de datos D10 se registra el código transparente STX (02
¿
Los códigos ASCII para las letras "A" y "B" se guardan en D11.
´
En el registro D12 se guarda el código transparente ETX (03
²
El registro de datos D13 aloja los códigos ASCII de los caracteres de control "CR" y "LF".
La instrucción BIDOUT se ejecuta y los datos de envío son transmitidos al módulo de
interfaz.
º
Después de la ejecución de la instrucción BIDOUT, M0 es puesto durante un ciclo PLC.
Cuando M1 no está puesto, ello significa que la instrucción ha sido ejecutada sin errores.
¾
Si se ha presentado un error durante la transmisión de los datos, también se pone la
marca M1. En este caso se pone la marca M100, con la que es posible por ejemplo visuali-
zar un aviso de error en una unidad de control.
Dispositivo externo
CPU del PLC
Iniciar la transmisión
(X50)
Instrucción BIDOUT
Instrucción BIDOUT
ejecutada (M0)
Instrucción BIDOUT
mal ejecutada (M1)
Fig. 16-25: Flujo de datos al enviar código transparente con el protocolo bidireccional
Sistema Q de MELSEC - Módulos de interfaz
Código adicional
2. Código transparente
E
Longi-
Datos
N
tud de
Q
(0004
)
H
D
L
L H
(1102
)
E
H
A
B
05
04
00
10
02
11
41
42
H
H
H
H
H
H
H
1. Código transparente
Código adicional
Código adicional: 10
(DLE)
H
1. Código transparente: 02
(STX)
H
2. Código transparente: 03
(ETX)
H
Intercambio de datos con el protocolo bidireccional
A
C
K
06
H
D
C
L
L
L H
E
(0003
)
R
F
H
10
0D
0A
B4
00
03
00
H
H
H
H
H
H
H
H
BIDOUT
Ejecución
normal
Ejecución
errónea
1 ciclo
Datos enviados
) y el valor 11
H
)
H
Se envían 4 palabras. Der El
código adicional no se cuenta
Unidad de la longitud de datos: palabras
D3
400
H
00
, 04
00
H
H
H
(1102
)
(1102
H
D10
401
H
11
, 02
11
H
H
H
(B) (A)
(B) (A)
D11
402
H
42
, 41
42
H
H
H
(0003
)
(0003
H
D12
403
H
00
, 03
00
H
H
H
(LF) (CR)
(LF) (CR)
D13
404
H
0A
, 0D
0A
H
H
H
CPU del PLC
Memoria buffer
.
H
, 04
H
)
H
, 02
H
, 41
H
)
H
, 03
H
, 0D
H
QK00390c
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