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modo (dual-slope) PWM, estos tres modos son preferidos para aplicación de
control de motores.
La resolución PWM para el modo de fase correcta puede ser arreglada a 8-, 9-,
o 10-bit, o definida por ICRn o OCRnA. La mínima resolución es 2 bits (ICRn o
OCRnA con uno en
0x0003), y la máxima resolución es 16 bits (ICRn o OCRnA en uno en la
dirección MAX 0xFFFF). La resolución PWM en bits puede ser calculada
usando la siguiente ecuación:
En modo de fase correcta PWM el contador es incrementado hasta el valor en el
punto uno de los valores arreglados 0x00FF, 0x01FF, o 0x03FF (WGMn3:0 = 1, 2,
o 3), el valor en ICRn (WGMn3:0 = 10), o el valor en OCRnA (WGMn3:0 = 11).
El contador tiene luego q alcanzar el TOPE y cambiar la dirección de la cuenta.
El valor TCNTn será igual al TOPE para un ciclo de reloj del timer. El diagrama
de tiempos para modo de fase correcta muestra el modo de fase correcta PWM
cuando OCRnA o ICRn son usados para definir el TOPE. EL valor TCNTn
incluye salidas PWM invertidas y no invertidas- La línea horizontal pequeña
marcada del TVNTn
representa el punto de comparación entre OCRnx y
TCNTn. La bandera de interrupción OCnx será uno cuando la comparación el
punto ocurra.
Diagrama de Tiempos en Modo de fase Correcta
La bandera de desbordamiento del Timer/Counter (TOVn) es uno cada vez que
el contador alcaza 0x00000. Cuando OCRnA o ICRn es usada para definir el
valor TOPE, el OCnA o ICFn es uno de acuerdo al mismo tiempo del ciclo de
reloj como los registros OCRnx son actualizados con el valor en doble buffer
(TOPE). La bandera de Interrupción puede ser usada para generar una
interrupción cada vez que el contador alcance el TOPE o el valor 0x0000.
Cuando se encuentra cargando el valor TOPE el programa asegura si el alto o
igual el valor de todos los registros de comparación. En el valor TOPE es el mas
bajo de los registros de comparación, el punto de comparación nunca ocurre
entre el TCNTn y el OCRnx.
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