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direccionamos, ellos, cambiarían al modo SR o ST, dependiendo del valor del
bit de LECTURA/ESCRITURA. Si ellos nos empiezan a direccionar, el cambio
no direccionaría el modo maestro u esperaría hasta que el bus este libre y
transmita una nueva condición, dependiendo de la acción del software de
aplicación.
20.9 DESCRIPCION DE REGISTROS
20.9.1 TWBR – TWI Bit Rate Register
• Bits 7:0 – Velocidad del Bit del Registro TWI
TWBR selecciona el factor de división para el bit generador de velocidad. Este
bit es la frecuencia dividida con lo cual genera la frecuencia de reloj SCL en los
modos Maestros.
20.9.2 TWCR – Registros de Control TWI
El TWCR es usado para el control de la operación del TWI. Esto es usado para
habilitar el TWI, al iniciar el acceso al Maestro aplicando la condición de
INICIO al bus, al generar el reconocimiento del Receptor, al generar una
condición de parada, y al detener el control del bus mientras el dato es escroto
al bus escribiendo al TWRD. Esto también indica la colisión de escritura al
TWRD mientras el registro es inaccesible.
• Bit 7 – TWINT: Bandera de Interrupción del TWI
Este bit es habilitado por hardware cuando el TWI ha finalizado esto actualiza
el trabajo y espera la respuesta de la aplicación por software. Si el bit-I en el
SREG y TWIE en TWCR son habilitadas, el MCU saltaría al vector de
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