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Cuando el bit TOIE2 es puesto en uno y el bit I del Registro de estado está en
uno, la interrupción para el desbordamiento del Timer/Counter2 es habilitada.
La interrupción correspondiente es ejecutada si un desbordamiento en el
Timer/Counter2 ocurre, por ejemplo cuando el bit TOV2 está es uno en el
Registro de las Banderas de Interrupción del Timer/Counter2 (TIFR2)
16.11.8 TIFR2 – Registro de Bandera de Interrupción del Timer/Counter2
• Bit 2 – OCF2B: Bandera Comparación de salida 2 B
El bit OCF2B es puesto en uno cuando ocurre una comparación entre el
Timer/Counter2 y el dato en el Registro Comparador de Salida OCF2B. El bit
OCF2B es limpiado por hardware cuando se ejecuta el correspondiente vector
de interrupción.
Alternativamente, OCF2B es limpiado al escribir un uno lógico en la bandera.
Cuando el bit I en el SREG, el OCIE2B (Habilitación de Interrupción del
Timer/Counter2) y el OCRB2B están en uno, se ejecuta la Interrupción del
Timer/Counter2.
• Bit 1 – OCF2A: Bandera de Comparación de Salida 2 A
El bit OCF2A es puesto en uno cuando ocurre una comparación entre el
Timer/Counter2 y el dato en el Registro Comparador de Salida OCF2A. El bit
OCF2A es limpiado por hardware cuando se ejecuta el correspondiente vector
de interrupción.
Alternativamente, OCF2A es limpiado al escribir un uno lógico en la bandera.
Cuando el bit I en el SREG, el OCIE2A (Habilitación de Interrupción del
Timer/Counter2) y el OCRB2A están en uno, se ejecuta la Interrupción del
Timer/Counter2.
• Bit 0 – TOV2: Bandera de Desbordamiento del Timer/Counter2
El bit TOV2 se pone a uno cuando ocurre un desbordamiento en el
Timer/Counter2. El bit TOV2 es limpiado por hardware cuando se ejecuta la
interrupción del vector correspondiente. Alternativamente, el TOV2 es
limpiado escribiendo un uno lógico en la bandera. Cuando el bit I del SREG, el
TOIE2A
(Habilitación
de
Interrupción
por
desbordamiento
del
Timer/Counter2) y el TOV2 están en uno, las Interrupciones por
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